差别
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stepmxo2-lab17 [2018/08/29 09:06] group001 创建 |
stepmxo2-lab17 [2018/08/29 09:07] (当前版本) group001 [实验步骤] |
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| 行 91: | 行 91: | ||
| =====实验步骤===== | =====实验步骤===== | ||
| - | - 1.打开Lattice Diamond，建立工程。 | + | - 打开Lattice Diamond，建立工程。 |
| - | - 2.新建Verilog HDL设计文件，并键入设计代码。 | + | - 新建Verilog HDL设计文件，并键入设计代码。 |
| - | - 3.根据逻辑综合并分配管脚，在本实验中引脚分配如下：clk---C1,rst_n---L14,clkout---N13 | + | - 根据逻辑综合并分配管脚，在本实验中引脚分配如下：clk---C1,rst_n---L14,clkout---N13 |
| - | - 4.如果仿真无误，构建并输出编程文件，烧写至FPGA的Flash之中。 | + | - 如果仿真无误，构建并输出编程文件，烧写至FPGA的Flash之中。 |
| - | - 5.观察输出结果。 | + | - 观察输出结果。 |