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ADALM2000口袋仪器

课程PPT

Verilog 代码

PWM代码 

module pwm
(
	//INPUT
	clk			,
	rst		,
	
	pwmout			
);

input clk,rst;
output pwmout;

wire [7:0] pwmin;
//reg [7:0]pwmin;


pwmpulse  u1
(
	.clk(clk)		,
	.rst(rst)		,
	.pwmin(pwmin),
	.pwmout(pwmout)			
);


assign pwmin = 8'd10;
			
endmodule