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altera_1led [2020/07/08 16:37]
zili [====小结====]
altera_1led [2020/07/08 16:37] (当前版本)
zili [====Verilog代码====]
行 23: 行 23:
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 ====Verilog代码==== ====Verilog代码====
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 <code verilog> <code verilog>